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      Entretien pour Design Verification Engineer

      17 févr. 2026
      Candidat à l'entretien anonyme
      Pilani

      Autres retours d’entretien d’embauche pour un poste comme Design Verification Engineer chez MediaTek

      Entretien pour Design Verification Engineer

      14 mai 2026
      Employé (anonyme)
      Taipei
      Offre acceptée
      Aucune offre
      Expérience positive
      Entretien moyen

      Candidature

      J'ai postulé via un établissement d'enseignement supérieur ou universitaire. J'ai passé un entretien chez MediaTek (Pilani) en août 2025

      Entretien

      It was an Online Assessment , followed by an interview. Interview had 3 technical rounds followed by an HR round. Question were mostly related to basics of digital design and verilog.

      Questions d'entretien [1]

      Question 1

      Basic Sorting in C. Counter Question in Verilog. STA and CDC concepts.
      Répondre à cette question
      Expérience positive
      Entretien moyen

      Candidature

      J'ai postulé via un établissement d'enseignement supérieur ou universitaire. J'ai passé un entretien chez MediaTek (Taipei) en mai 2026

      Entretien

      lots of technical problem , and also ask me about the AMBA AXI protocol they don't ask me lots of questions about my project how to explain while you coding is important

      Entretien pour Design Verification Engineer

      30 avr. 2025
      Candidat à l'entretien anonyme
      Offre refusée
      Expérience neutre
      Entretien facile

      Candidature

      J'ai postulé via un recruteur. Le processus a pris 1 semaine. J'ai passé un entretien chez MediaTek

      Entretien

      Introduce and ask questions based on the slides, focusing on computer organization content. Before the interview, a FIFO verification task will be given, and modifications will also be required on the spot

      Questions d'entretien [1]

      Question 1

      how to write uvm top
      Répondre à cette question