Questions d'entretien VLSI Design Engineer chez AMD

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AMD

Entretiens

Entretien pour VLSI Design Engineer

25 janv. 2020

Candidat à l'entretien anonyme

Aucune offre

Expérience neutre

Entretien difficile

Candidature

J'ai postulé via un établissement d'enseignement supérieur ou universitaire. J'ai passé un entretien chez AMD (Warangal) en janv. 2020

Entretien

They asked my gate rank.and they asked the following questions.they came to my campus for both VLSI design and verification domains.they finally asked me what if i am not selected?the way interview had gone is demotivating way.

Questions d'entretien [5]

Question 1

vlsi process flow

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Question 2

what happens in synthesis process?what initially vivado tool is doing during synthesis process?write a verilog code for synchronous d flipflop?

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Question 3

set up time and hold time

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Question 4

difference between malloc and calloc

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Question 5

explain about your project

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